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參數資料
| 型號： | AD9913BCPZ-REEL71 |
| 廠商： | Analog Devices, Inc. |
| 元件分類： | XO, clock |
| 英文描述： | Low Power 250 MSPS 10-Bit DAC 1.8 V CMOS Direct Digital Synthesizer |
| 中文描述： | 低功耗250 MSPS的10位DAC 1.8伏CMOS直接數字頻率合成器 |
| 文件頁數： | 9/32頁 |
| 文件大小： | 473K |
| 代理商： | AD9913BCPZ-REEL71 |
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AD9913
Rev. 0 | Page 9 of 32
–50
–90
0
250
0
SYSTEM CLOCK (MHz)
S
–55
–60
–65
–70
–75
–80
–85
50
100
150
200
39.88%
26.58%
10.21%
Figure 10. SFDR vs. System Clock Frequency (PLL Bypassed)
–100
–170
10
100M
0
FREQUENCY (MHz)
P
–110
–120
–130
–140
–150
–160
100
1k
10k
100k
1M
10M
92.3MHz
48.9MHz
23.1MHz
6.1MHz
Figure 11. Residual Phase Noise vs. f
OUT
(PLL Bypassed)
150
50
100
100M
FREQUENCY (MHz)
P
1k
10k
100k
1M
10M
60
70
80
90
100
110
120
130
140
99MHz
12.5MHz
49MHz
25MHz
0
Figure 12. Absolute Phase Noise vs. f
OUT
Using the Internal PLL
(REF_CLK 25 MHz × 10 = 250 MHz Using PLL)
–50
–90
0
0
0
f
OUT
(% of System Clock)
S
.45
–55
–60
–65
–70
–75
–80
–85
0.05
0.10
0.15
0.20
0.25
0.30
0.35
0.40
REFSPUR
PLL ×10
BYPASS
Figure 13. SFDR Without the Internal PLL
(REF_CLK = 25 MHz × 10 = 250 MHz Using PLL, 4 mA DAC Full-Scale Current)
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