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參數資料
| 型號： | AD8109-EB |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | 325 MHz, 8 x 8 Buffered Video Crosspoint Switches |
| 中文描述： | 325兆赫，8 × 8的緩沖視頻交叉點開關 |
| 文件頁數： | 7/28頁 |
| 文件大小： | 434K |
| 代理商： | AD8109-EB |
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AD8108/AD8109
–7–
REV. 0
PIN FUNCT ION DE SCRIPT IONS
Pin Name
Pin Numbers
Pin Description
INxx
DAT A IN
CLK
DAT A OUT
UPDAT E
1, 3, 5, 7, 9, 11, 13, 15
57
58
59
56
Analog Inputs; xx = Channel Numbers 00 T hrough 07.
Serial Data Input, T T L Compatible.
Clock, T T L Compatible. Falling Edge T riggered.
Serial Data Out, T T L Compatible.
Enable (T ransparent) “Low.” Allows serial register to connect directly to switch
matrix. Data latched when “High.”
Disable Outputs, Active “Low.”
Chip Enable, Enable “Low.”
Must be “low” to clock in and latch data.
Selects Serial Data Mode, “Low” or Parallel Data Mode, “High.”
Must be connected.
Analog Outputs yy = Channel Numbers 00 T hrough 07.
Analog Ground for Inputs and Switch Matrix.
+5 V for Digital Circuitry.
Ground for Digital Circuitry.
–5 V for Inputs and Switch Matrix.
+5 V for Inputs and Switch Matrix
Ground for Output Amp, xx = Output Channel Numbers 00 T hrough 07.
Must be connected.
+5 V for Output Amplifier that is shared by Channel Numbers xx and yy.
Must beconnected.
–5 V for Output Amplifier that is shared by Channel Numbers xx and yy.
Must be connected.
Parallel Data Input, T T L Compatible (Output Select LSB).
Parallel Data Input, T T L Compatible (Output Select).
Parallel Data Input, T T L Compatible (Output Select MSB).
Parallel Data Input, T T L Compatible (Input Select LSB).
Parallel Data Input, T T L Compatible (Input Select).
Parallel Data Input, T T L Compatible (Input Select MSB).
Parallel Data Input, T T L Compatible (Output Enable).
Not Connected.
RESET
CE
SER
/
PAR
OUT yy
AGND
DVCC
DGND
AVEE
AVCC
AGNDxx
AVCCxx/yy
AVEExx/yy
A0
A1
A2
D0
D1
D2
D3
NC
61
60
55
41, 38, 35, 32, 29, 26, 23, 20
2, 4, 6, 8, 10, 12, 14, 16, 46
63, 79
62, 80
17, 45
18, 44
42, 39, 36, 33, 30, 27, 24, 21
43, 37, 31, 25, 22, 19
40, 34, 28, 22
54
53
52
51
50
49
48
47, 64–78
Figure 5. I/O Schematics
d. Logic Input
e. Logic Output
ESD
ESD
INPUT
V
CC
AVEE
ESD
ESD
OUTPUT
V
CC
AVEE
1k
V
(AD8109 ONLY)
ESD
ESD
RESET
V
CC
20k
V
DGND
ESD
ESD
INPUT
V
CC
DGND
ESD
ESD
OUTPUT
V
CC
DGND
2k
V
a. Analog Input
c. Reset Input
b. Analog Output
相關PDF資料 |
PDF描述 |
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